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gpio: gpio-lpc32xx: Add gpio_to_irq mapping
This patch helps mapping with gpio_to_irq for the GPIOs that are irq enabled. Signed-off-by: Roland Stigge <stigge@antcom.de> Tested-by: Alexandre Pereira da Silva <aletes.xgr@gmail.com> Signed-off-by: Linus Walleij <linus.walleij@linaro.org>
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parent
0c65ddd460
commit
0bdfeddc49
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@ -28,6 +28,7 @@
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#include <mach/hardware.h>
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#include <mach/platform.h>
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#include <mach/gpio-lpc32xx.h>
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#include <mach/irqs.h>
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#define LPC32XX_GPIO_P3_INP_STATE _GPREG(0x000)
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#define LPC32XX_GPIO_P3_OUTP_SET _GPREG(0x004)
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@ -367,6 +368,66 @@ static int lpc32xx_gpio_request(struct gpio_chip *chip, unsigned pin)
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return -EINVAL;
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}
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static int lpc32xx_gpio_to_irq_p01(struct gpio_chip *chip, unsigned offset)
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{
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return IRQ_LPC32XX_P0_P1_IRQ;
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}
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static const char lpc32xx_gpio_to_irq_gpio_p3_table[] = {
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IRQ_LPC32XX_GPIO_00,
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IRQ_LPC32XX_GPIO_01,
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||||
IRQ_LPC32XX_GPIO_02,
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IRQ_LPC32XX_GPIO_03,
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||||
IRQ_LPC32XX_GPIO_04,
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||||
IRQ_LPC32XX_GPIO_05,
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};
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static int lpc32xx_gpio_to_irq_gpio_p3(struct gpio_chip *chip, unsigned offset)
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{
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if (offset < ARRAY_SIZE(lpc32xx_gpio_to_irq_gpio_p3_table))
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return lpc32xx_gpio_to_irq_gpio_p3_table[offset];
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return -ENXIO;
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}
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static const char lpc32xx_gpio_to_irq_gpi_p3_table[] = {
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IRQ_LPC32XX_GPI_00,
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IRQ_LPC32XX_GPI_01,
|
||||
IRQ_LPC32XX_GPI_02,
|
||||
IRQ_LPC32XX_GPI_03,
|
||||
IRQ_LPC32XX_GPI_04,
|
||||
IRQ_LPC32XX_GPI_05,
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IRQ_LPC32XX_GPI_06,
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IRQ_LPC32XX_GPI_07,
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IRQ_LPC32XX_GPI_08,
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IRQ_LPC32XX_GPI_09,
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-ENXIO, /* 10 */
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-ENXIO, /* 11 */
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-ENXIO, /* 12 */
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-ENXIO, /* 13 */
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-ENXIO, /* 14 */
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-ENXIO, /* 15 */
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-ENXIO, /* 16 */
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-ENXIO, /* 17 */
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-ENXIO, /* 18 */
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IRQ_LPC32XX_GPI_19,
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-ENXIO, /* 20 */
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-ENXIO, /* 21 */
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-ENXIO, /* 22 */
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-ENXIO, /* 23 */
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-ENXIO, /* 24 */
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-ENXIO, /* 25 */
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-ENXIO, /* 26 */
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-ENXIO, /* 27 */
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IRQ_LPC32XX_GPI_28,
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};
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static int lpc32xx_gpio_to_irq_gpi_p3(struct gpio_chip *chip, unsigned offset)
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{
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if (offset < ARRAY_SIZE(lpc32xx_gpio_to_irq_gpi_p3_table))
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||||
return lpc32xx_gpio_to_irq_gpi_p3_table[offset];
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||||
return -ENXIO;
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}
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static struct lpc32xx_gpio_chip lpc32xx_gpiochip[] = {
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{
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.chip = {
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@ -376,6 +437,7 @@ static struct lpc32xx_gpio_chip lpc32xx_gpiochip[] = {
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|||
.direction_output = lpc32xx_gpio_dir_output_p012,
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||||
.set = lpc32xx_gpio_set_value_p012,
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||||
.request = lpc32xx_gpio_request,
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||||
.to_irq = lpc32xx_gpio_to_irq_p01,
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||||
.base = LPC32XX_GPIO_P0_GRP,
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||||
.ngpio = LPC32XX_GPIO_P0_MAX,
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||||
.names = gpio_p0_names,
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@ -391,6 +453,7 @@ static struct lpc32xx_gpio_chip lpc32xx_gpiochip[] = {
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|||
.direction_output = lpc32xx_gpio_dir_output_p012,
|
||||
.set = lpc32xx_gpio_set_value_p012,
|
||||
.request = lpc32xx_gpio_request,
|
||||
.to_irq = lpc32xx_gpio_to_irq_p01,
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||||
.base = LPC32XX_GPIO_P1_GRP,
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||||
.ngpio = LPC32XX_GPIO_P1_MAX,
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||||
.names = gpio_p1_names,
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@ -421,6 +484,7 @@ static struct lpc32xx_gpio_chip lpc32xx_gpiochip[] = {
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|||
.direction_output = lpc32xx_gpio_dir_output_p3,
|
||||
.set = lpc32xx_gpio_set_value_p3,
|
||||
.request = lpc32xx_gpio_request,
|
||||
.to_irq = lpc32xx_gpio_to_irq_gpio_p3,
|
||||
.base = LPC32XX_GPIO_P3_GRP,
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||||
.ngpio = LPC32XX_GPIO_P3_MAX,
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||||
.names = gpio_p3_names,
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||||
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@ -434,6 +498,7 @@ static struct lpc32xx_gpio_chip lpc32xx_gpiochip[] = {
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.direction_input = lpc32xx_gpio_dir_in_always,
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.get = lpc32xx_gpi_get_value,
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.request = lpc32xx_gpio_request,
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||||
.to_irq = lpc32xx_gpio_to_irq_gpi_p3,
|
||||
.base = LPC32XX_GPI_P3_GRP,
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||||
.ngpio = LPC32XX_GPI_P3_MAX,
|
||||
.names = gpi_p3_names,
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