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arm64: tegra: Initial Tegra234 VDK support
The NVIDIA Tegra234 VDK is a simulation platform for the Orin SoC. It supports a subset of the peripherals that will be available in the final chip and serves as a bootstrapping platform. Reviewed-by: Jon Hunter <jonathanh@nvidia.com> Signed-off-by: Thierry Reding <treding@nvidia.com>
This commit is contained in:
Thierry Reding
parent
2b9ee384b4
commit
639448912b
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@ -9,3 +9,4 @@ dtb-$(CONFIG_ARCH_TEGRA_210_SOC) += tegra210-p2894-0050-a08.dtb
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dtb-$(CONFIG_ARCH_TEGRA_186_SOC) += tegra186-p2771-0000.dtb
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dtb-$(CONFIG_ARCH_TEGRA_186_SOC) += tegra186-p2771-0000.dtb
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||||||
dtb-$(CONFIG_ARCH_TEGRA_194_SOC) += tegra194-p2972-0000.dtb
|
dtb-$(CONFIG_ARCH_TEGRA_194_SOC) += tegra194-p2972-0000.dtb
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||||||
dtb-$(CONFIG_ARCH_TEGRA_194_SOC) += tegra194-p3509-0000+p3668-0000.dtb
|
dtb-$(CONFIG_ARCH_TEGRA_194_SOC) += tegra194-p3509-0000+p3668-0000.dtb
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||||||
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dtb-$(CONFIG_ARCH_TEGRA_234_SOC) += tegra234-sim-vdk.dtb
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40
arch/arm64/boot/dts/nvidia/tegra234-sim-vdk.dts
Normal file
40
arch/arm64/boot/dts/nvidia/tegra234-sim-vdk.dts
Normal file
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@ -0,0 +1,40 @@
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// SPDX-License-Identifier: GPL-2.0
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/dts-v1/;
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#include "tegra234.dtsi"
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/ {
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model = "NVIDIA Tegra234 VDK";
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compatible = "nvidia,tegra234-vdk", "nvidia,tegra234";
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aliases {
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sdhci3 = "/cbb@0/sdhci@3460000";
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serial0 = &uarta;
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};
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chosen {
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bootargs = "console=ttyS0,115200n8 earlycon=uart8250,mmio32,0x03100000";
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stdout-path = "serial0:115200n8";
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};
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||||||
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cbb@0 {
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||||||
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serial@3100000 {
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||||||
|
status = "okay";
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|
};
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||||||
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|
||||||
|
sdhci@3460000 {
|
||||||
|
status = "okay";
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||||||
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bus-width = <8>;
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||||||
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non-removable;
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only-1-8-v;
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|
};
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||||||
|
|
||||||
|
rtc@c2a0000 {
|
||||||
|
status = "okay";
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||||||
|
};
|
||||||
|
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||||||
|
pmc@c360000 {
|
||||||
|
nvidia,invert-interrupt;
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|
};
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||||||
|
};
|
||||||
|
};
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||||||
189
arch/arm64/boot/dts/nvidia/tegra234.dtsi
Normal file
189
arch/arm64/boot/dts/nvidia/tegra234.dtsi
Normal file
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@ -0,0 +1,189 @@
|
||||||
|
// SPDX-License-Identifier: GPL-2.0
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||||||
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||||||
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#include <dt-bindings/clock/tegra234-clock.h>
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||||||
|
#include <dt-bindings/interrupt-controller/arm-gic.h>
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||||||
|
#include <dt-bindings/mailbox/tegra186-hsp.h>
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||||||
|
#include <dt-bindings/reset/tegra234-reset.h>
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||||||
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/ {
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|
compatible = "nvidia,tegra234";
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|
interrupt-parent = <&gic>;
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||||||
|
#address-cells = <2>;
|
||||||
|
#size-cells = <2>;
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||||||
|
|
||||||
|
bus@0 {
|
||||||
|
compatible = "simple-bus";
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <1>;
|
||||||
|
|
||||||
|
ranges = <0x0 0x0 0x0 0x40000000>;
|
||||||
|
|
||||||
|
misc@100000 {
|
||||||
|
compatible = "nvidia,tegra234-misc";
|
||||||
|
reg = <0x00100000 0xf000>,
|
||||||
|
<0x0010f000 0x1000>;
|
||||||
|
status = "okay";
|
||||||
|
};
|
||||||
|
|
||||||
|
uarta: serial@3100000 {
|
||||||
|
compatible = "nvidia,tegra234-uart", "nvidia,tegra20-uart";
|
||||||
|
reg = <0x03100000 0x10000>;
|
||||||
|
interrupts = <GIC_SPI 112 IRQ_TYPE_LEVEL_HIGH>;
|
||||||
|
clocks = <&bpmp TEGRA234_CLK_UARTA>;
|
||||||
|
clock-names = "serial";
|
||||||
|
resets = <&bpmp TEGRA234_RESET_UARTA>;
|
||||||
|
reset-names = "serial";
|
||||||
|
status = "disabled";
|
||||||
|
};
|
||||||
|
|
||||||
|
mmc@3460000 {
|
||||||
|
compatible = "nvidia,tegra234-sdhci", "nvidia,tegra186-sdhci";
|
||||||
|
reg = <0x03460000 0x20000>;
|
||||||
|
interrupts = <GIC_SPI 65 IRQ_TYPE_LEVEL_HIGH>;
|
||||||
|
clocks = <&bpmp TEGRA234_CLK_SDMMC4>;
|
||||||
|
clock-names = "sdhci";
|
||||||
|
resets = <&bpmp TEGRA234_RESET_SDMMC4>;
|
||||||
|
reset-names = "sdhci";
|
||||||
|
dma-coherent;
|
||||||
|
status = "disabled";
|
||||||
|
};
|
||||||
|
|
||||||
|
fuse@3810000 {
|
||||||
|
compatible = "nvidia,tegra234-efuse";
|
||||||
|
reg = <0x03810000 0x10000>;
|
||||||
|
clocks = <&bpmp TEGRA234_CLK_FUSE>;
|
||||||
|
clock-names = "fuse";
|
||||||
|
};
|
||||||
|
|
||||||
|
hsp_top0: hsp@3c00000 {
|
||||||
|
compatible = "nvidia,tegra234-hsp", "nvidia,tegra194-hsp";
|
||||||
|
reg = <0x03c00000 0xa0000>;
|
||||||
|
interrupts = <GIC_SPI 176 IRQ_TYPE_LEVEL_HIGH>,
|
||||||
|
<GIC_SPI 120 IRQ_TYPE_LEVEL_HIGH>,
|
||||||
|
<GIC_SPI 121 IRQ_TYPE_LEVEL_HIGH>,
|
||||||
|
<GIC_SPI 122 IRQ_TYPE_LEVEL_HIGH>,
|
||||||
|
<GIC_SPI 123 IRQ_TYPE_LEVEL_HIGH>,
|
||||||
|
<GIC_SPI 124 IRQ_TYPE_LEVEL_HIGH>,
|
||||||
|
<GIC_SPI 125 IRQ_TYPE_LEVEL_HIGH>,
|
||||||
|
<GIC_SPI 126 IRQ_TYPE_LEVEL_HIGH>,
|
||||||
|
<GIC_SPI 127 IRQ_TYPE_LEVEL_HIGH>;
|
||||||
|
interrupt-names = "doorbell", "shared0", "shared1", "shared2",
|
||||||
|
"shared3", "shared4", "shared5", "shared6",
|
||||||
|
"shared7";
|
||||||
|
#mbox-cells = <2>;
|
||||||
|
};
|
||||||
|
|
||||||
|
hsp_aon: hsp@c150000 {
|
||||||
|
compatible = "nvidia,tegra234-hsp", "nvidia,tegra194-hsp";
|
||||||
|
reg = <0x0c150000 0x90000>;
|
||||||
|
interrupts = <GIC_SPI 133 IRQ_TYPE_LEVEL_HIGH>,
|
||||||
|
<GIC_SPI 134 IRQ_TYPE_LEVEL_HIGH>,
|
||||||
|
<GIC_SPI 135 IRQ_TYPE_LEVEL_HIGH>,
|
||||||
|
<GIC_SPI 136 IRQ_TYPE_LEVEL_HIGH>;
|
||||||
|
/*
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||||||
|
* Shared interrupt 0 is routed only to AON/SPE, so
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||||||
|
* we only have 4 shared interrupts for the CCPLEX.
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||||||
|
*/
|
||||||
|
interrupt-names = "shared1", "shared2", "shared3", "shared4";
|
||||||
|
#mbox-cells = <2>;
|
||||||
|
};
|
||||||
|
|
||||||
|
rtc@c2a0000 {
|
||||||
|
compatible = "nvidia,tegra234-rtc", "nvidia,tegra20-rtc";
|
||||||
|
reg = <0x0c2a0000 0x10000>;
|
||||||
|
interrupt-parent = <&pmc>;
|
||||||
|
interrupts = <73 IRQ_TYPE_LEVEL_HIGH>;
|
||||||
|
status = "disabled";
|
||||||
|
};
|
||||||
|
|
||||||
|
pmc: pmc@c360000 {
|
||||||
|
compatible = "nvidia,tegra234-pmc";
|
||||||
|
reg = <0x0c360000 0x10000>,
|
||||||
|
<0x0c370000 0x10000>,
|
||||||
|
<0x0c380000 0x10000>,
|
||||||
|
<0x0c390000 0x10000>,
|
||||||
|
<0x0c3a0000 0x10000>;
|
||||||
|
reg-names = "pmc", "wake", "aotag", "scratch", "misc";
|
||||||
|
|
||||||
|
#interrupt-cells = <2>;
|
||||||
|
interrupt-controller;
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||||||
|
};
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||||||
|
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||||||
|
gic: interrupt-controller@f400000 {
|
||||||
|
compatible = "arm,gic-v3";
|
||||||
|
reg = <0x0f400000 0x010000>, /* GICD */
|
||||||
|
<0x0f440000 0x200000>; /* GICR */
|
||||||
|
interrupt-parent = <&gic>;
|
||||||
|
interrupts = <GIC_PPI 9 (GIC_CPU_MASK_SIMPLE(4) | IRQ_TYPE_LEVEL_HIGH)>;
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||||||
|
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|
#redistributor-regions = <1>;
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||||||
|
#interrupt-cells = <3>;
|
||||||
|
interrupt-controller;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
sysram@40000000 {
|
||||||
|
compatible = "nvidia,tegra234-sysram", "mmio-sram";
|
||||||
|
reg = <0x0 0x40000000 0x0 0x50000>;
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <1>;
|
||||||
|
ranges = <0x0 0x0 0x40000000 0x50000>;
|
||||||
|
|
||||||
|
cpu_bpmp_tx: shmem@4e000 {
|
||||||
|
reg = <0x4e000 0x1000>;
|
||||||
|
label = "cpu-bpmp-tx";
|
||||||
|
pool;
|
||||||
|
};
|
||||||
|
|
||||||
|
cpu_bpmp_rx: shmem@4f000 {
|
||||||
|
reg = <0x4f000 0x1000>;
|
||||||
|
label = "cpu-bpmp-rx";
|
||||||
|
pool;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
bpmp: bpmp {
|
||||||
|
compatible = "nvidia,tegra234-bpmp", "nvidia,tegra186-bpmp";
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||||||
|
mboxes = <&hsp_top0 TEGRA_HSP_MBOX_TYPE_DB
|
||||||
|
TEGRA_HSP_DB_MASTER_BPMP>;
|
||||||
|
shmem = <&cpu_bpmp_tx &cpu_bpmp_rx>;
|
||||||
|
#clock-cells = <1>;
|
||||||
|
#reset-cells = <1>;
|
||||||
|
#power-domain-cells = <1>;
|
||||||
|
|
||||||
|
bpmp_i2c: i2c {
|
||||||
|
compatible = "nvidia,tegra186-bpmp-i2c";
|
||||||
|
nvidia,bpmp-bus-id = <5>;
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
cpus {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
|
||||||
|
cpu@0 {
|
||||||
|
device_type = "cpu";
|
||||||
|
reg = <0x000>;
|
||||||
|
|
||||||
|
enable-method = "psci";
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
psci {
|
||||||
|
compatible = "arm,psci-1.0";
|
||||||
|
status = "okay";
|
||||||
|
method = "smc";
|
||||||
|
};
|
||||||
|
|
||||||
|
timer {
|
||||||
|
compatible = "arm,armv8-timer";
|
||||||
|
interrupts = <GIC_PPI 13 (GIC_CPU_MASK_SIMPLE(4) | IRQ_TYPE_LEVEL_LOW)>,
|
||||||
|
<GIC_PPI 14 (GIC_CPU_MASK_SIMPLE(4) | IRQ_TYPE_LEVEL_LOW)>,
|
||||||
|
<GIC_PPI 11 (GIC_CPU_MASK_SIMPLE(4) | IRQ_TYPE_LEVEL_LOW)>,
|
||||||
|
<GIC_PPI 10 (GIC_CPU_MASK_SIMPLE(4) | IRQ_TYPE_LEVEL_LOW)>;
|
||||||
|
interrupt-parent = <&gic>;
|
||||||
|
always-on;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
@ -119,6 +119,16 @@ config ARCH_TEGRA_194_SOC
|
||||||
help
|
help
|
||||||
Enable support for the NVIDIA Tegra194 SoC.
|
Enable support for the NVIDIA Tegra194 SoC.
|
||||||
|
|
||||||
|
config ARCH_TEGRA_234_SOC
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||||||
|
bool "NVIDIA Tegra234 SoC"
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||||||
|
select MAILBOX
|
||||||
|
select TEGRA_BPMP
|
||||||
|
select TEGRA_HSP_MBOX
|
||||||
|
select TEGRA_IVC
|
||||||
|
select SOC_TEGRA_PMC
|
||||||
|
help
|
||||||
|
Enable support for the NVIDIA Tegra234 SoC.
|
||||||
|
|
||||||
endif
|
endif
|
||||||
endif
|
endif
|
||||||
|
|
||||||
|
|
|
||||||
14
include/dt-bindings/clock/tegra234-clock.h
Normal file
14
include/dt-bindings/clock/tegra234-clock.h
Normal file
|
|
@ -0,0 +1,14 @@
|
||||||
|
/* SPDX-License-Identifier: GPL-2.0 */
|
||||||
|
/* Copyright (c) 2018-2019, NVIDIA CORPORATION. All rights reserved. */
|
||||||
|
|
||||||
|
#ifndef DT_BINDINGS_CLOCK_TEGRA234_CLOCK_H
|
||||||
|
#define DT_BINDINGS_CLOCK_TEGRA234_CLOCK_H
|
||||||
|
|
||||||
|
/** @brief output of gate CLK_ENB_FUSE */
|
||||||
|
#define TEGRA234_CLK_FUSE 40
|
||||||
|
/** @brief output of mux controlled by CLK_RST_CONTROLLER_CLK_SOURCE_SDMMC4 */
|
||||||
|
#define TEGRA234_CLK_SDMMC4 123
|
||||||
|
/** @brief output of mux controlled by CLK_RST_CONTROLLER_CLK_SOURCE_UARTA */
|
||||||
|
#define TEGRA234_CLK_UARTA 155
|
||||||
|
|
||||||
|
#endif
|
||||||
10
include/dt-bindings/reset/tegra234-reset.h
Normal file
10
include/dt-bindings/reset/tegra234-reset.h
Normal file
|
|
@ -0,0 +1,10 @@
|
||||||
|
/* SPDX-License-Identifier: GPL-2.0 */
|
||||||
|
/* Copyright (c) 2018-2020, NVIDIA CORPORATION. All rights reserved. */
|
||||||
|
|
||||||
|
#ifndef DT_BINDINGS_RESET_TEGRA234_RESET_H
|
||||||
|
#define DT_BINDINGS_RESET_TEGRA234_RESET_H
|
||||||
|
|
||||||
|
#define TEGRA234_RESET_SDMMC4 85
|
||||||
|
#define TEGRA234_RESET_UARTA 100
|
||||||
|
|
||||||
|
#endif
|
||||||
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